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반도체 및 DRAM 설계를 공부하면서 정리한 내용으로 틀린 내용이 있을 수 있습니다. :) 이전글1. DRAM Cell 정리 [1] (1T1C Cell, Cell Array, Cell Layout) 이전글에서 DRAM Cell을 구체적인 구현에 대해서 정리하였다.  DRAM Cell은 1T1C 구조로 1개의 Transistor (Tr)와 1개의 Capacitor (Cap)로 구성된다. Cap 는 1 bit 데이터를 저장하는 저장소 역할로, 전기가 Cap 에 모여있으면 1 bit를 비어있으면 0 bit를 의미한다. Tr 는 데이터를 쓸지 말지를 결정하는 스위치 역할로, Tr 가 On되면 Cap 가 외부 회로와 연결되어 데이터를 쓰거나 데이터를 읽어올 수 있다. 1T1C Cell은 Word Line (WL)..

반도체 및 DRAM 설계를 공부하면서 정리한 내용으로 틀린 내용이 있을 수 있습니다. :) 1T1C Cell & Cell Array Schematic Fig 1. 은 DRAM Cell과 Cell들의 배치를 나타내는 Schematic diagram이다. DRAM Cell 하나는 1 Transistor & 1 Capacitor (1T1C 구조)로 이루어진다[2]. 이전글에서도 정리하였는데, Capacitor는 전기 신호 1 또는 0을 저장하는 기억소자 역할을 담당한다. Capacitor에 일정량 이상의 전하가 충전되면 1이 저장되었음을 의미한다. 반대로 Capacitor가 방전되었을 때에는 0이 저장되었음을 의미한다.  Transistor (NMOS)는 전자가 Capacitor에 쌓이거나 혹은 방출되도록 조..